瑞萨推出第一代 32 位 RISC-V CPU 内核,性能接近 ARM Cortex-M3
发表于:2024-09-22 作者:千家信息网编辑
千家信息网最后更新 2024年09月22日,感谢CTOnews.com网友 OC_Formula 的线索投递!CTOnews.com 12 月 7 日消息,瑞萨电子今日宣布成功设计、测试并推出基于开放标准 RISC-V 指令集架构(ISA)的
千家信息网最后更新 2024年09月22日瑞萨推出第一代 32 位 RISC-V CPU 内核,性能接近 ARM Cortex-M3
感谢CTOnews.com网友 OC_Formula 的线索投递!
CTOnews.com 12 月 7 日消息,瑞萨电子今日宣布成功设计、测试并推出基于开放标准 RISC-V 指令集架构(ISA)的 32 位 CPU 内核。
据介绍,瑞萨作为业内首个为 32 位通用 RISC-V 市场独立研发 CPU 内核的厂商,面向物联网、消费电子、医疗保健和工业系统打造了一个开放、灵活的平台。新的 RISC-V CPU 内核将扩充瑞萨现有 32 位微控制器(MCU)IP 产品阵容,包括专有 RX 产品家族和基于 Arm Cortex-M 架构的 RA 产品家族。
RISC-V 是一种开放式 ISA,因其灵活性、可扩展性、高能效和开放式的生态系统,在半导体行业迅速普及。目前众多 MCU 供应商建立联合投资联盟,以加快 RISC-V 产品的开发。
瑞萨电子表示,此款多功能 CPU 既可作为主应用控制器,也可成为 SoC、片上子系统,甚至深度嵌入式 ASSP 中的辅助核心,CoreMark / MHz 性能达到了 3.27。(CTOnews.com注:CoreMark / MHz 是指单位时间内 CoreMark 程序的运行次数,ARM Cortex-M3 的这一数据为 3.32,性能大致相当)
CTOnews.com从官方博客获悉,瑞萨正在向部分客户提供基于新内核的样品,并计划于 2024 年一季度推出首款基于 RISC-V 的 MCU 及相关开发工具,届时也将公布全新 MCU 产品的详细信息。
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